K4H511638D-UCCC
vdd：2.5V±0.2V的范围：±2.5V VDDQ的话，ddr266，333•±0.1V的VDDQ vdd：2.6伏特：±0.1V为2.6伏特，双数据速率ddr400•每时钟数据传输体系结构；双数据选通DQS cycle•bidirectional [ ]和[（x4，x8）L（U）]（X16的DQS）。operation•四组差分时钟输入（CK和CK）•DQ和DQS的DLL aligns过渡与CK transition•夫人与重点项目周期的地址。潜伏期：读（2，2.5 ddr266时钟（时钟），ddr333 DDR400（2.5），3 -时钟）。突发长度（2，4，8）。突发类型（与输入顺序轮流）•所有采样日期和DM是除美国正走向边缘的系统时钟（CK）的交易数据的I / O•在边缘的边缘对准输出数据strobe•日期，日期input•LDM的中心对准，是只写udm掩蔽（X16）•DM是写掩蔽只读（x4，x8）•自我与自我刷新间隔时间（refresh•7.8us 8k／64ms最大突发刷新刷新周期：）•8•66pin无铅封装TSOP II
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